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傳輸門.CVSL邏輯電路設計要求

時間:2009-11-11 19:57:23來源:原創 作者:admin 點擊:

一.設計指標時間以24小時為一個周期;顯示時、分、秒;有校時功能,可以分別對時及分進行單獨校時,使其校正到標準時間;計時過程具有報時功能,當時間到達整點前5秒進行蜂鳴報時;為了保證計時的穩定及準確須由晶體振蕩器提供表針時間基準信號。

 
二.設計要求畫出電路原理圖(或仿真電路圖);元器件及參數選擇;電路仿真與調試;PCB文件生成與打印輸出。


三.制作要求 自行裝配和調試,并能發現問題和解決問題。

 
四.編寫設計報告 寫出設計與制作的全過程,附上有關資料和圖紙,有心得體會。三、設計原理及其框圖1.數字鐘的構成數字鐘實際上是一個對標準頻率(1HZ)進行計數的計數電路。由于計數的起始時間不可能與標準時間(如北京時間)一致,故需要在電路上加一個校時電路,同時標準的1HZ時間信號必須做到準確穩定。通常使用石英晶體振蕩器電路構成數字鐘。

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